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WebShop半導体シリーズ>完全ディジタルPLL回路の設計


ディープ・サブミクロンCMOSプロセスで実現する

完全ディジタルPLL回路の設計

 無線通信回路の周波数シンセサイザやマイクロプロセッサの高速クロック生成回路において必須となるPLL(位相同期回路)を完全にディジタル回路で構成するという設計思想が,完全ディジタルPLL回路(ADPLL)です.
 本書は,この設計思想を解説した「All-Digital Frequency Synthesizer in Deep-Submicron CMOS」を翻訳したものです.
  • Robert Bogdan Staszewski/Poras T.Balsara / 著
    山田 庸一郎 / 訳
    小林 春夫 / 監訳
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